侵權投訴

基于FPGA實現小波變換系統的應用設計

電子設計 ? 2021-04-14 15:51 ? 次閱讀

作者:謝宏;劉玉霞;金曼;夏斌

1 引言

腦電信號EEG(Electroencephalograph)是人體一種基本生理信號,具有重要的臨床診斷和醫療價值。南于腦電信號自身具有非平穩性隨機的特點,因此,對其實時濾波具有相當難度。自從Berger 1929年發現腦電信號以來,人們采用多種數字信號處理技術處理分析腦電信號,由于傳統的濾波去噪方法所用濾波器一般具有低通特性,因此采用經典濾波法對非平穩信號去噪,降低噪聲,展寬波形,平滑信號中突變尖峰的成分,但可能損失這些突變點攜帶的重要信息,而傅里葉頻譜分析僅是一種純頻率分析方法,該方法對時變的非平穩腦電信號無效。

與傳統的傅里葉變換相比較,小波變換是一種多尺度信號分析方法,具有良好的時頻局部化特性,非常適合分析非平穩信號的瞬態特性和時變特性,這正是分析 EEG所需要的,EEG中許多病變都是以瞬態形式表現的。只有結合時間和頻率進行處理,才能取得更好效果。但小波分解每次只分解上次分解的低頻部分,而不分解高頻部分,所以高頻段分辨率較差。而小波包分解是一種從小波分解延伸出的更細致的分解和重構信號的方法,它不但分解低頻部分,而且還能二次分解高頻部分,能夠很好地將頻率分辨率調整到與腦電節律特性相一致,因此小波包分解具有更好的濾波特性。若將小波包方法引入腦電信號分析.不僅可以克服傳統腦電分析的不足.還可以改進Mallat算法分析實際腦電中的不足。

腦電信號的數字處理以往采用通用PC機或單片機實現,存在實時性差等缺點。隨之,基于FPGA的小波變換在腦電信號數字處理中應運而生,其實時性好。 DSP Builder將Matlab/Simulink設計仿真工具的算法開發、模擬和驗證功能和Quartus II軟件的HDL綜合、模擬和驗證功能相結合,為小波變換的FPGA提供良好的平臺。

2 一維離散小波(1D-DWT)Mallat改進算法

多分辨率分析是小波分析的核心理論,其Mallat算法是信號小波分解和重構的常用算法。正交小波的分解和重構公式由尺度函數的尺度方程系數確定。假設構造正交小波的尺度函數φ(t)的兩尺度方程為:

由于φ(-t)和φ(t-s)為構造正交小波的多分辨率分析尺度函數,因此上述分解和重構公式中取h(n)為h(-n)或h(n-s)均可。為了討論方便,且不失一般性,可將上述分解公式和重構公式重寫為:

則c0(k)=c0(k-2N-1),式(13)得到的信號是式(12)得到信號的延遲。由于序列h(n)和g(n)為因果序列,所以式(13)對應的濾波器為因果濾波器。采用式(7)和式(8)繼續分解信號低頻分量或低頻分量與高頻分量.可得多級分解或小波包分解。

3 基于DSP Builder的小波變換設計實現

考慮到瞬態脈沖信號的短時性,選擇具有緊支集的Daubenchies小波作為分析小波,這樣有利于突出瞬態信號特征,DB小波函數具有良好的正交性和緊支撐性,可較好地表現頻域信號的連續性和突變性,在實際工程應用中效果較好。故這里采用DB小波對腦電信號進行4級分解重構。濾除腦電信號中存在的直流成分或緩慢基線漂移。選取DB2小波,此時M=3,且低通濾波系數(尺度函數系數)如下:

由于浮點數在FPGA中實現比較復雜,為了減少FPGA的運算量和資源,可將濾波計算轉換為整數運算和移位運算,為此首先需將以上濾波器系數轉化為整數,對每個濾波器系數采用16位字長進行量化,即乘以215后取整數,而對濾波器的輸出信號有移15位即得到實際輸出。

以DSP Builder為平臺,對式(7)、式(8)和式(13)算法進行系統級建模、仿真,再利用Signal Compiler生成HDL文件,然后利用Quartus II進行時序仿真驗證。

3.1 DSP Builder實現lD-DWT分解

分解模塊的結構如圖1所示。信號并行從4級延遲線輸出,與FIR濾波器系數進行卷積,然后再偶抽取便可得到近似部分和細節部分的結果。二次抽取模塊采用DSP Builder的下采樣模塊,利用Signal Compiler生成HDL文件。

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為了減少系統耗用的硬件資源,舍去輸出結果的低8位,保證分解前后信號保持同樣能量級。從圖1中可知,各個子模塊并行工作,子模塊之間無需任何交叉信號,數據從輸入端以流水線的方式向后傳遞,實現實時流水線工作。二級分解模塊的設計原理同一級分解模塊。

3.2 DSP Builder實現1D-DWT重構

由Mallat算法可知重構模塊的結構如圖2所示。首先對信號二次插值,然后信號并行從四級延遲線輸出,分別與FIR濾波器系數進行卷積,與分解不同的是重構有兩路信號輸入,經過四級延遲后并行分別與FIR濾波器卷積,得到的結果再疊加便可得到重構信號,接著利用Signal Compiler生成HDL文件,重構模塊也是以流水線方式工作的。二次捕值模塊由DSP Builder的上采樣模塊實現。

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4 仿真與設計

選定一組原始數據[1,2,3,4,5,6,7,8,9,10,11…],同時作為輸入信號,利用圖1生成的HDL文件,在Quartus II環境下時序仿真,圖3為一級小波分解時序仿真波形。利用圖2生成的HDL文件,同時把圖3低頻高頻的輸出結果作為重構輸入數據,進行一級小波重構仿真,仿真波形如圖4所示。由圖3、圖4可以看出,重建后波形除有延遲外,其重建波形無失真,并能完美重構原信號,即輸入、輸出滿足q(n)=xin(n- k)。

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利用小波變換的多尺度分解和重構方法濾除信號的某些成分(高頻或低頻),采用DB2小波對腦電信號進行四級小波包分解,按照小波包分解原理,級聯一級分解模塊,每經一次分解輸入的一串數據降為原來的一半.采用分頻模塊控制各級時鐘信號,分頻模塊由VHDL語言編寫生成.同步輸出3個時鐘信號,以此作為后三級分解的時鐘輸入信號。然后對分解后的輸出信號進行四級小波包重構,按同樣方式處理,級聯一級重構模塊,每重構一次輸出數據都增為原來的2倍。嘗試采用鎖相環控制各級時鐘信號,鎖相環由Quartus II自帶的功能模塊實現,同時輸出3個倍頻時鐘信號,作為后i級重構部分的輸入時鐘信號。

5 結論

利用信號的小波包分解高分辨率的時頻關系.在濾波部分選取因果濾波器對腦電信號進行實時濾波。在DSP Builder平臺上,結合Mallat算法和模塊化設計原則,設計出基于FPGA的流水線結構小波變換系統,這種自上而下的高度模塊化設計方法使得系統的升級改動相當方便,將這種基于FPGA的小波變換系統設計應用于腦電信號的實時濾波,是今后的研究方向。

責任編輯:gt

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發表于 04-18 20:10 ? 124次 閱讀
THS1009 10 位 8MSPS ADC,具有雙通道、并行 DSP/uP、通道自動掃描和低功耗

TLV1572 10 位 1.25 MSPS ADC 單通道 DSP/(Q)SPI IF S 極低功耗自動斷電功能

信息描述The TLV1572 is a high-speed 10-bit successive-approximation analog-to-digital converter (ADC) that operates from a single 2.7-V to 5.5-V power supply and is housed in a small 8-pin SOIC package.The TLV1572 accepts an analog input range from 0 to VCC and digitizes the input at a maximum 1.25 MSPS throughput rate. The power dissipation is only 8 mW with a 3-V supply or 25 mW with a 5-V supply. The device features an auto-powerdown mode that automatically powers down to 10 uA whenever a conversion is not performed. The TLV1572 communicates with digital microprocessors via a simple 3- or 4-wire serial port that interfaces directly to the Texas Instruments TMS320 DSPs and (Q)SPI compatible microcontrollers without using additional glue logic. Very high throughput rate, simple serial interface, SO-8 package, 3-V operation, and low power consumption make the TLV1572 an ideal choice for compact or remote high-speed systems.特性F...
發表于 04-18 20:09 ? 112次 閱讀
TLV1572 10 位 1.25 MSPS ADC 單通道 DSP/(Q)SPI IF S 極低功耗自動斷電功能

TLV1578 8 通道 10 位 1.25MSPS ADC,具有 8 通道輸出、DSP/SPI、硬件可配置、低功耗

信息描述The TLV1571/1578 is a 10-bit data acquisition system that combines an 8-channel input multiplexer (MUX), a high-speed 10-bit ADC, and a parallel interface. The device contains two on-chip control registers allowing control of channel selection, software conversion start, and power down via the bidirectional parallel port. The control registers can be set to a default mode by applying a dummy RD\ signal when WR\ is tied low. This allows the TLV1571/1578 to be configured by hardware. The MUX is independently accessible. This allows the user to insert a signal conditioning circuit such as an antialiasing filter or an amplifier, if required, between the MUX and the ADC. Therefore, one signal conditioning circuit can be used for all eight channels. The TLV1571 is a single channel analog input device with all the same functions as the TLV1578. The TLV1571/TLV1578 operates from a single 2.7-V to 5.5-V power supply. It accepts an ana...
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TLV1578 8 通道 10 位 1.25MSPS ADC,具有 8 通道輸出、DSP/SPI、硬件可配置、低功耗

TLV1571 1 通道 10 位 1.25MSPS ADC,具有 8 通道輸出、DSP/SPI、硬件可配置、低功耗

信息描述The TLV1571/1578 is a 10-bit data acquisition system that combines an 8-channel input multiplexer (MUX), a high-speed 10-bit ADC, and a parallel interface. The device contains two on-chip control registers allowing control of channel selection, software conversion start, and power down via the bidirectional parallel port. The control registers can be set to a default mode by applying a dummy RD\ signal when WR\ is tied low. This allows the TLV1571/1578 to be configured by hardware. The MUX is independently accessible. This allows the user to insert a signal conditioning circuit such as an antialiasing filter or an amplifier, if required, between the MUX and the ADC. Therefore, one signal conditioning circuit can be used for all eight channels. The TLV1571 is a single channel analog input device with all the same functions as the TLV1578. The TLV1571/TLV1578 operates from a single 2.7-V to 5.5-V power supply. It accepts an ana...
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TLV1571 1 通道 10 位 1.25MSPS ADC,具有 8 通道輸出、DSP/SPI、硬件可配置、低功耗

TLV1548 10 位 85kSPS ADC 系列 輸出,可編程供電/斷電/轉換速率,TMS320 DSP/SPI/QPSI Compat.,8 通道

信息描述The TLV1544 and TLV1548 are CMOS 10-bit switched-capacitor successive-approximation (SAR) analog-to-digital (A/D) converters. Each device has a chip select (CS\), input-output clock (I/O CLK), data input (DATA IN) and serial data output (DATA OUT) that provide a direct 4-wire synchronous serial peripheral interface (SPITM, QSPITM) port of a host microprocessor. When interfacing with a TMS320 DSP, an additional frame sync signal (FS) indicates the start of a serial data frame. The devices allow high-speed data transfers from the host. The (INV CLK)\ input provides further timing flexibility for the serial interface. In addition to a high-speed converter and versatile control capability, the device has an on-chip 11-channel multiplexer that can select any one of eight analog inputs or any one of three internal self-test voltages. The sample-and-hold function is automatic except for the extended sampling cycle,...
發表于 04-18 20:09 ? 66次 閱讀
TLV1548 10 位 85kSPS ADC 系列 輸出,可編程供電/斷電/轉換速率,TMS320 DSP/SPI/QPSI Compat.,8 通道

TLV1544 10 位 85kSPS ADC 串行 輸出,可編程供電/斷電/轉換速率,TMS320 DSP/SPI/QPSI 兼容,4 通道

信息描述The TLV1544 and TLV1548 are CMOS 10-bit switched-capacitor successive-approximation (SAR) analog-to-digital (A/D) converters. Each device has a chip select (CS\), input-output clock (I/O CLK), data input (DATA IN) and serial data output (DATA OUT) that provide a direct 4-wire synchronous serial peripheral interface (SPITM, QSPITM) port of a host microprocessor. When interfacing with a TMS320 DSP, an additional frame sync signal (FS) indicates the start of a serial data frame. The devices allow high-speed data transfers from the host. The (INV CLK)\ input provides further timing flexibility for the serial interface. In addition to a high-speed converter and versatile control capability, the device has an on-chip 11-channel multiplexer that can select any one of eight analog inputs or any one of three internal self-test voltages. The sample-and-hold function is automatic except for the extended sampling cycle,...
發表于 04-18 20:09 ? 56次 閱讀
TLV1544 10 位 85kSPS ADC 串行 輸出,可編程供電/斷電/轉換速率,TMS320 DSP/SPI/QPSI 兼容,4 通道

TLV1570 10 位 1.25MSPS ADC 8 通道 DSP/(Q)SPI IF 可編程內部 基準、自動或 S/W 斷電、極低功耗

信息描述The TLV1570 is a 10-bit data acquisition system that combines an 8-channel input multiplexer (MUX), a high-speed 10-bit ADC, an on-chip reference, and a high-speed serial interface. The device contains an on-chip control register allowing control of channel selection, conversion start, reference voltage levels, and power down via the serial port. The MUX is independently accessible, which allows the user to insert a signal conditioning circuit such as an antialiasing filter or an amplifier, if required, between the MUX and the ADC. Therefore one signal conditioning circuit can be used for all eight channels.The TLV1570 operates from a single 2.7-V to 5.5-V power supply. The device accepts an analog input range from 0 V to AVDD and digitizes the input at a maximum 1.25 MSPS throughput rate. Power dissipation is only 8 mW with a 2.7-V supply or 40 mW with a 5.5-V supply. The device features an autopower-down mode that automatically ...
發表于 04-18 20:09 ? 70次 閱讀
TLV1570 10 位 1.25MSPS ADC 8 通道 DSP/(Q)SPI IF 可編程內部 基準、自動或 S/W 斷電、極低功耗

TLC1550 10 位,164kSPS ADC,并行輸出、直接 I/F 到 DSP/uProcessor、10 通道

信息描述The TLC1550x and TLC1551 are data acquisition analog-to-digital converters (ADCs) using a 10-bit, switched-capacitor, successive-approximation network. A high-speed, 3-state parallel port directly interfaces to a digital signal processor (DSP) or microprocessor (μP) system data bus. D0 through D9 are the digital output terminals with D0 being the least significant bit (LSB). Separate power terminals for the analog and digital portions minimize noise pickup in the supply leads. Additionally, the digital power is divided into two parts to separate the lower current logic from the higher current bus drivers. An external clock can be applied to CLKIN to override the internal system clock if desired. The TLC1550I and TLC1551I are characterized for operation from ?40°C to 85°C. The TLC1550M is characterized over the full military range of ?55°C to 125°C.特性Power Dissipation...40 mW Max Advanced LinEPIC? Single-Po...
發表于 04-18 20:07 ? 117次 閱讀
TLC1550 10 位,164kSPS ADC,并行輸出、直接 I/F 到 DSP/uProcessor、10 通道

TLC1518 10 位 400kSPS ADC,具有串行輸出、SPI/DSP 兼容接口、關斷狀態、8 通道

信息描述The TLC1518 and TLC1514 are a family of high-performance, 10-bit, low power, 1.4 us, CMOS SAR analog-to-digital converters (ADC) which operate from a single 5 V power supply. These devices have three digital inputs and a 3-state output [chip select (CS\), serial input-output clock (SCLK), serial data input (SDI), and serial data output (SDO)] that provide a direct 4-wire interface to the serial port of most popular host microprocessors (SPI interface). When interfaced with a DSP, a frame sync (FS) signal is used to indicate the start of a serial data frame. In addition to a high-speed A/D converter and versatile control capability, these devices have an on-chip analog multiplexer that can select any analog inputs or one of three internal self-test voltages. The sample-and-hold function is automatically started after the fourth SCLK edge (normal sampling) or can be controlled by a special pin, CSTART\, to extend the sampl...
發表于 04-18 20:07 ? 158次 閱讀
TLC1518 10 位 400kSPS ADC,具有串行輸出、SPI/DSP 兼容接口、關斷狀態、8 通道

TLC1514 10 位 400kSPS ADC,具有串行輸出、SPI/DSP 兼容接口、關斷狀態、4 通道

信息描述The TLC1518 and TLC1514 are a family of high-performance, 10-bit, low power, 1.4 us, CMOS SAR analog-to-digital converters (ADC) which operate from a single 5 V power supply. These devices have three digital inputs and a 3-state output [chip select (CS\), serial input-output clock (SCLK), serial data input (SDI), and serial data output (SDO)] that provide a direct 4-wire interface to the serial port of most popular host microprocessors (SPI interface). When interfaced with a DSP, a frame sync (FS) signal is used to indicate the start of a serial data frame. In addition to a high-speed A/D converter and versatile control capability, these devices have an on-chip analog multiplexer that can select any analog inputs or one of three internal self-test voltages. The sample-and-hold function is automatically started after the fourth SCLK edge (normal sampling) or can be controlled by a special pin, CSTART\, to extend the sampl...
發表于 04-18 20:07 ? 140次 閱讀
TLC1514 10 位 400kSPS ADC,具有串行輸出、SPI/DSP 兼容接口、關斷狀態、4 通道

TLC1551 10 位,164kSPS ADC 并行輸出,直接 I/F 至 DSP/微處理器,10 通道

信息描述The TLC1550x and TLC1551 are data acquisition analog-to-digital converters (ADCs) using a 10-bit, switched-capacitor, successive-approximation network. A high-speed, 3-state parallel port directly interfaces to a digital signal processor (DSP) or microprocessor (μP) system data bus. D0 through D9 are the digital output terminals with D0 being the least significant bit (LSB). Separate power terminals for the analog and digital portions minimize noise pickup in the supply leads. Additionally, the digital power is divided into two parts to separate the lower current logic from the higher current bus drivers. An external clock can be applied to CLKIN to override the internal system clock if desired. The TLC1550I and TLC1551I are characterized for operation from ?40°C to 85°C. The TLC1550M is characterized over the full military range of ?55°C to 125°C.特性Power Dissipation...40 mW Max Advanced LinEPIC? Single-Po...
發表于 04-18 20:07 ? 146次 閱讀
TLC1551 10 位,164kSPS ADC 并行輸出,直接 I/F 至 DSP/微處理器,10 通道

THS12082 12 位、8MSPS ADC,具有雙通道、DSP/uP 接口、16X FIFO、通道自動掃描、低功耗

信息描述The THS12082 is a CMOS, low-power, 12-bit, 8 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers allow for programming the ADC into the desired mode. The THS12082 consists of two analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential inputs. An integrated 16 word deep FIFO allows the storage of data in order to take the load off of the processor connected to the ADC. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided.An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the appl...
發表于 04-18 20:06 ? 219次 閱讀
THS12082 12 位、8MSPS ADC,具有雙通道、DSP/uP 接口、16X FIFO、通道自動掃描、低功耗

THS1209 12 位、8 MSPS ADC 雙通道、DSP/uP 接口、通道自動掃描、低功耗

信息描述The THS1209 is a CMOS, low-power, 12-bit, 8 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers allow for programming the ADC into the desired mode. The THS1209 consists of two analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential inputs. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided. An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the application. The THS1209C is characterized for operation from 0°C to 70°C, and the THS1209I is characterized for operation from ...
發表于 04-18 20:06 ? 219次 閱讀
THS1209 12 位、8 MSPS ADC 雙通道、DSP/uP 接口、通道自動掃描、低功耗

THS1207 12 位,6MSPS 同步采樣四通道 ADC;包括并行 DSP/uP I/F 通道自動掃描

信息描述The THS1207 is a CMOS, low-power, 12-bit, 6 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers are used to program the ADC into the desired mode. The THS1207 consists of four analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential-inputs. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided. An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the application. The THS1207C is characterized for operation from 0°C to 70°C, the THS1207Iis characterized for operation from ?40°...
發表于 04-18 20:05 ? 294次 閱讀
THS1207 12 位,6MSPS 同步采樣四通道 ADC;包括并行 DSP/uP I/F 通道自動掃描

BELASIGNA R281 始終聆聽,語音觸發音頻DSP系統

信息 BelaSigna?R281是一款超低功耗語音觸發解決方案,適用于各種消費電子設備。在典型的應用中,BelaSigna R281“始終在聆聽”。并且將檢測單個用戶訓練的觸發短語,當檢測到該觸發短語時斷言喚醒信號。 “始終開啟”。平均功耗小于300 uW的關鍵短語檢測(不包括麥克風的功耗)可保持待機電池壽命。 BelaSigna R281是一款超小型解決方案,可同時提供采用5 mm x 5mm QFN32封裝和2.42 mm x 2.74 mm WLCSP封裝。它可以設計在單層PCB上,具有4 mil布線和最少量的外部元件。 需要一個外部的I C主控制器來配置器件進行操作。 超低功耗 卓越績效 混合信號 Easy Design-In 優勢特點 主要功能 久經考驗的超低功耗數字信號處理(DSP)技術 ?最初為助聽器開發的音頻DSP技術在以下方面具備所需的計算能力極低電流消耗 ?...
發表于 04-18 19:42 ? 141次 閱讀
BELASIGNA R281 始終聆聽,語音觸發音頻DSP系統

THS10082 具有雙通道、并行 DSP/uP 接口、16X FIFO、通道自動掃描、低功耗的 10 位 8MSPS ADC

信息描述The THS10082 is a CMOS, low-power, 10-bit, 8 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers allow for programming the ADC into the desired mode. The THS10082 consists of two analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential inputs. An integrated 16 word deep FIFO allows the storage of data in order to take the load off of the processor connected to the ADC. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided. An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the app...
發表于 04-18 19:06 ? 132次 閱讀
THS10082 具有雙通道、并行 DSP/uP 接口、16X FIFO、通道自動掃描、低功耗的 10 位 8MSPS ADC

THS1206 12 位 6MSPS ADC,具有四通道 (配置),DSP/uP IF,集成 16x FIFO、信道自動掃描功能和低功耗模式

信息描述The THS1206 is a CMOS, low-power, 12-bit, 6 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers are used to program the ADC into the desired mode. The THS1206 consists of four analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential inputs. An integrated 16 word deep FIFO allows the storage of data in order to take the load off of the processor connected to the ADC. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided. An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the applic...
發表于 04-18 19:06 ? 183次 閱讀
THS1206 12 位 6MSPS ADC,具有四通道 (配置),DSP/uP IF,集成 16x FIFO、信道自動掃描功能和低功耗模式

THS1007 10 位 6MSPS 同步采樣四路通道 ADC;包含并行 DSP/uP I/F 通道 自動掃描

信息描述 The THS1007 is a CMOS, low-power, 10-bit, 6 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers are used to program the ADC into the desired mode. The THS1007 consists of four analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential inputs. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided. An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the application. The THS1007C is characterized for operation from 0°C to 70°C, and the THS1007I is characterized for operation from ...
發表于 04-18 19:06 ? 137次 閱讀
THS1007 10 位 6MSPS 同步采樣四路通道 ADC;包含并行 DSP/uP I/F 通道 自動掃描

THS10064 10 位 6MSPS ADC,具有四通道 (可配置)、DSP/uP IF、集成 16x FIFO、通道 自動掃描和低功耗

信息描述The THS10064 is a CMOS, low-power, 10-bit, 6 MSPS analog-to-digital converter (ADC). The speed, resolution, bandwidth, and single-supply operation are suited for applications in radar, imaging, high-speed acquisition, and communications. A multistage pipelined architecture with output error correction logic provides for no missing codes over the full operating temperature range. Internal control registers are used to program the ADC into the desired mode. The THS10064 consists of four analog inputs, which are sampled simultaneously. These inputs can be selected individually and configured to single-ended or differential inputs. An integrated 16 word deep FIFO allows the storage of data in order to improve data transfers to the processor. Internal reference voltages for the ADC (1.5 V and 3.5 V) are provided. An external reference can also be chosen to suit the dc accuracy and temperature drift requirements of the application. Two diffe...
發表于 04-18 19:06 ? 172次 閱讀
THS10064 10 位 6MSPS ADC,具有四通道 (可配置)、DSP/uP IF、集成 16x FIFO、通道 自動掃描和低功耗
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